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MT48LC2M32B2P-55:G
器件3D模型
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MT48LC2M32B2P-55:G数据手册
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Table 2: Address Table
Parameter 2 Meg x 32
Configuration 512K x 32 x 4 banks
Refresh count 4K
Row addressing 2K A[10:0]
Bank addressing 4 BA[1:0]
Column addressing 256 A[7:0]
Table 3: 64Mb (x32) SDR Part Numbering
Part Numbers Architecture Package
MT48LC2M32B2TG 2 Meg x 32 86-pin TSOP II
MT48LC2M32B2P 2 Meg x 32 86-pin TSOP II
MT48LC2M32B2B5
1
2 Meg x 32 90-ball VFBGA
Note:
1. FBGA Device Decoder: www.micron.com/decoder.
64Mb: x32 SDRAM
Features
PDF: 09005aef811ce1fe
64mb_x32_sdram.pdf - Rev. V 09/14 EN
2
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MT48LC2M32B2P-55:G 数据手册

Micron(镁光)
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Micron(镁光)
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MT48LC2M32B2P55 数据手册

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