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器件3D模型￥ 19.604
STM32F051R4T6 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-64
描述:
STM32F05 系列微处理器，STMicroelectronicsSTM32F05 微控制器系列 ARM Cortex™-M0 32 位 RISC 内核工作频率高达 48MHz，带高速闪存和一系列增强型外设，它们还包括 I²C、SPI、I²S 和 USART 通信接口、计时器、ADC 和 DAC。 ARM Cortex™-M0 STM32 F05，具有实时性能，可低功耗工作，能够在 STMicroelectronics STM32 平台上运行。 微控制器可用于如 HVAC、应用控制、消费者电器用具、PC 外设、手持设备及其他许多应用领域。Cortex™-M0：48MHz 频率 12 位 ADC；16 位计时器；32 位计时器和一个高级控制 PWM 计时器 温度范围：-40°C 至 +85°C 或 -40°C 至 +105°C 温度 电源：2V 至 3.6V **STM32F05**：闪存多达 32kB，SRAM 多达 4kB **STM32F051x4**、**STM32F051x6** 和 **STM32F051x8**：闪存多达 64kB，SRAM 多达 8kB ### STM32F0 系列 32 位 ARM® Cortex®-M0 微控制器，STMicroelectronicsSTM32 F0 系列 32 位闪存微控制器 (MCU) 基于 ARM Cortex™-M0 核心；为嵌入式应用特别开发的核心。 STMicroelectronics 的 STM32 ARM Cortex™ M 处理器得益于 Cortex-M0 体系结构增强功能，包括数字信号处理、实时性能、低电压和低功率。 ST ARM® STM32 F0 主流系列提供 32 位性能，且特别适用于小项目或平台决策，具有易于使用功能。展开
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DocID026137 Rev 3 3/89
UM1741 Contents
4
3.6.15 DAC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
3.6.16 Comparator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.6.17 TIM 6/7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.6.18 TIM1/2/3/14/15/16/17 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
3.6.19 GPIO – PORT A/B/C/D/E/F . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
3.6.20 Real Time Clock module (RTC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
3.6.21 Supply voltage system . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
3.6.22 Reset and clock control subsystem . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
3.6.23 Watchdogs (IWDG, WWDG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.24 Debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.25 Cyclic Redundancy Check module (CRC) . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.26 Dual MCU architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
3.6.27 Latent fault detection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
3.6.28 Disable and periodic cross-check of unintentional activation of
unused peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
3.7 Conditions of use . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
4 Safety results . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
4.1 Hardware random failure safety results . . . . . . . . . . . . . . . . . . . . . . . . . . 44
4.1.1 Safety analysis result customization . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
4.1.2 General requirements for Freedom From Interferences (FFI) . . . . . . . . 45
4.2 Dependent failures analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
4.2.1 Power supply . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
4.2.2 Clock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
4.2.3 DMA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
4.2.4 Internal temperature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
5 List of evidences . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48
Appendix A Overview of fRMethodology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.1 The essence of fRMethodology. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.2 fRMethodology and its flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.3 fRTools . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
Appendix B Examples of safety architectures – Informative . . . . . . . . . . . . . . . 53
B.1 Conceptual block diagrams of the target safety architectures. . . . . . . . . . 53
B.2 Considerations about voter implementation . . . . . . . . . . . . . . . . . . . . . . . 55
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