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器件3D模型￥ 4.911
STM32F072C8T6 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-48
描述:
STM32F 系列 64 kB 闪存 16 kB RAM 48 MHz 32-位 微控制器 - LQFP-48
Pictures:
3D模型
符号图
焊盘图
引脚图
产品图
页面导航:
原理图在P43P51P58P59P60P65P66P67P68
电气规格在P16P35
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STM32F072C8T6数据手册
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DocID026137 Rev 3 3/89
UM1741 Contents
4
3.6.15 DAC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
3.6.16 Comparator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.6.17 TIM 6/7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.6.18 TIM1/2/3/14/15/16/17 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
3.6.19 GPIO – PORT A/B/C/D/E/F . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
3.6.20 Real Time Clock module (RTC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
3.6.21 Supply voltage system . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
3.6.22 Reset and clock control subsystem . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
3.6.23 Watchdogs (IWDG, WWDG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.24 Debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.25 Cyclic Redundancy Check module (CRC) . . . . . . . . . . . . . . . . . . . . . . . 36
3.6.26 Dual MCU architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
3.6.27 Latent fault detection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
3.6.28 Disable and periodic cross-check of unintentional activation of
unused peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
3.7 Conditions of use . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
4 Safety results . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
4.1 Hardware random failure safety results . . . . . . . . . . . . . . . . . . . . . . . . . . 44
4.1.1 Safety analysis result customization . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
4.1.2 General requirements for Freedom From Interferences (FFI) . . . . . . . . 45
4.2 Dependent failures analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
4.2.1 Power supply . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
4.2.2 Clock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
4.2.3 DMA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
4.2.4 Internal temperature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
5 List of evidences . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48
Appendix A Overview of fRMethodology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.1 The essence of fRMethodology. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.2 fRMethodology and its flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
A.3 fRTools . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
Appendix B Examples of safety architectures – Informative . . . . . . . . . . . . . . . 53
B.1 Conceptual block diagrams of the target safety architectures. . . . . . . . . . 53
B.2 Considerations about voter implementation . . . . . . . . . . . . . . . . . . . . . . . 55
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