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器件3D模型￥ 14.038
STM32F401CBY6TT 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
WLCSP-49
描述:
ARM Cortex-M4 84MHz 闪存：128K@x8bit RAM：64KB
Pictures:
3D模型
符号图
焊盘图
引脚图
产品图
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STM32F401CBY6TT数据手册
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DocID025350 Rev 4 5/841
RM0368 Contents
23
6.3.5 RCC AHB1 peripheral reset register (RCC_AHB1RSTR) . . . . . . . . . . 111
6.3.6 RCC AHB2 peripheral reset register (RCC_AHB2RSTR) . . . . . . . . . . 113
6.3.7 RCC APB1 peripheral reset register for (RCC_APB1RSTR) . . . . . . . 113
6.3.8 RCC APB2 peripheral reset register (RCC_APB2RSTR) . . . . . . . . . . 115
6.3.9 RCC AHB1 peripheral clock enable register (RCC_AHB1ENR) . . . . . 117
6.3.10 RCC AHB2 peripheral clock enable register (RCC_AHB2ENR) . . . . . 118
6.3.11 RCC APB1 peripheral clock enable register (RCC_APB1ENR) . . . . . 118
6.3.12 RCC APB2 peripheral clock enable register
(RCC_APB2ENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121
6.3.13 RCC AHB1 peripheral clock enable in low power mode register
(RCC_AHB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
6.3.14 RCC AHB2 peripheral clock enable in low power mode register
(RCC_AHB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 124
6.3.15 RCC APB1 peripheral clock enable in low power mode register
(RCC_APB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125
6.3.16 RCC APB2 peripheral clock enabled in low power mode register
(RCC_APB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127
6.3.17 RCC Backup domain control register (RCC_BDCR) . . . . . . . . . . . . . . 129
6.3.18 RCC clock control & status register (RCC_CSR) . . . . . . . . . . . . . . . . 130
6.3.19 RCC spread spectrum clock generation register (RCC_SSCGR) . . . . 132
6.3.20 RCC PLLI2S configuration register (RCC_PLLI2SCFGR) . . . . . . . . . 133
6.3.21 RCC Dedicated Clocks Configuration Register (RCC_DCKCFGR) . . 135
6.3.22 RCC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 136
7 System configuration controller (SYSCFG) . . . . . . . . . . . . . . . . . . . . 139
7.1 I/O compensation cell . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139
7.2 SYSCFG registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139
7.2.1 SYSCFG memory remap register (SYSCFG_MEMRMP) . . . . . . . . . . 139
7.2.2 SYSCFG peripheral mode configuration register (SYSCFG_PMC) . . 140
7.2.3 SYSCFG external interrupt configuration register 1
(SYSCFG_EXTICR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141
7.2.4 SYSCFG external interrupt configuration register 2
(SYSCFG_EXTICR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141
7.2.5 SYSCFG external interrupt configuration register 3
(SYSCFG_EXTICR3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142
7.2.6 SYSCFG external interrupt configuration register 4
(SYSCFG_EXTICR4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142
7.2.7 Compensation cell control register (SYSCFG_CMPCR) . . . . . . . . . . . 143
7.2.8 SYSCFG register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144
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