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器件3D模型￥ 8.276
STM32F446RET7 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-64
描述:
ARM微控制器 - MCU 16/32-BITS MICROS
Pictures:
3D模型
符号图
焊盘图
引脚图
产品图
页面导航:
引脚图在P183P184P1288Hot
典型应用电路图在P307
原理图在P247P937P1267P1285
功能描述在P201P239P851P1301P1303
技术参数、封装参数在P980
应用领域在P851
电气规格在P70P83P96P115P159
导航目录
STM32F446RET7数据手册
Page:
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DocID026976 Rev 2 5/1323
RM0390 Contents
34
6.3.4 RCC clock interrupt register (RCC_CIR) . . . . . . . . . . . . . . . . . . . . . . . 130
6.3.5 RCC AHB1 peripheral reset register (RCC_AHB1RSTR) . . . . . . . . . . 133
6.3.6 RCC AHB2 peripheral reset register (RCC_AHB2RSTR) . . . . . . . . . . 135
6.3.7 RCC AHB3 peripheral reset register (RCC_AHB3RSTR) . . . . . . . . . . 135
6.3.8 RCC APB1 peripheral reset register (RCC_APB1RSTR) . . . . . . . . . . 136
6.3.9 RCC APB2 peripheral reset register (RCC_APB2RSTR) . . . . . . . . . . 139
6.3.10 RCC AHB1 peripheral clock enable register (RCC_AHB1ENR) . . . . . 141
6.3.11 RCC AHB2 peripheral clock enable register (RCC_AHB2ENR) . . . . . 142
6.3.12 RCC AHB3 peripheral clock enable register (RCC_AHB3ENR) . . . . . 143
6.3.13 RCC APB1 peripheral clock enable register (RCC_APB1ENR) . . . . . 143
6.3.14 RCC APB2 peripheral clock enable register (RCC_APB2ENR) . . . . . 146
6.3.15 RCC AHB1 peripheral clock enable in low power mode register
(RCC_AHB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148
6.3.16 RCC AHB2 peripheral clock enable in low power mode register
(RCC_AHB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150
6.3.17 RCC AHB3 peripheral clock enable in low power mode register
(RCC_AHB3LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150
6.3.18 RCC APB1 peripheral clock enable in low power mode register
(RCC_APB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 151
6.3.19 RCC APB2 peripheral clock enabled in low power mode register
(RCC_APB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155
6.3.20 RCC Backup domain control register (RCC_BDCR) . . . . . . . . . . . . . . 156
6.3.21 RCC clock control & status register (RCC_CSR) . . . . . . . . . . . . . . . . 158
6.3.22 RCC spread spectrum clock generation register (RCC_SSCGR) . . . . 159
6.3.23 RCC PLLI2S configuration register (RCC_PLLI2SCFGR) . . . . . . . . . 160
6.3.24 RCC PLL configuration register (RCC_PLLSAICFGR) . . . . . . . . . . . . 163
6.3.25 RCC Dedicated Clock Configuration Register (RCC_DCKCFGR) . . . 164
6.3.26 RCC clocks gated enable register (CKGATENR) . . . . . . . . . . . . . . . . 166
6.3.27 RCC dedicated clocks configuration register 2 (DCKCFGR2) . . . . . . . 167
6.3.28 RCC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 169
7 General-purpose I/Os (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173
7.1 GPIO introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173
7.2 GPIO main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173
7.3 GPIO functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173
7.3.1 General-purpose I/O (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 175
7.3.2 I/O pin multiplexer and mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 175
7.3.3 I/O port control registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 177
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