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器件3D模型￥ 87.908
STM32F745ZET6 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-144
描述:
DSP和FPU的高性能32位MCU
Pictures:
3D模型
符号图
焊盘图
引脚图
产品图
页面导航:
引脚图在P874P875P1617Hot
典型应用电路图在P365
原理图在P304P538P545P586P1109P1596P1614
功能描述在P220P254P291P1051P1631P1633
技术参数、封装参数在P585P1188
应用领域在P1051
电气规格在P81P92P104P130P182
导航目录
STM32F745ZET6数据手册
Page:
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DocID026670 Rev 5 5/1661
RM0385 Contents
41
5.3.5 RCC AHB1 peripheral reset register (RCC_AHB1RSTR) . . . . . . . . . . 149
5.3.6 RCC AHB2 peripheral reset register (RCC_AHB2RSTR) . . . . . . . . . . 152
5.3.7 RCC AHB3 peripheral reset register (RCC_AHB3RSTR) . . . . . . . . . . 153
5.3.8 RCC APB1 peripheral reset register (RCC_APB1RSTR) . . . . . . . . . . 153
5.3.9 RCC APB2 peripheral reset register (RCC_APB2RSTR) . . . . . . . . . . 157
5.3.10 RCC AHB1 peripheral clock register (RCC_AHB1ENR) . . . . . . . . . . . 159
5.3.11 RCC AHB2 peripheral clock enable register (RCC_AHB2ENR) . . . . . 161
5.3.12 RCC AHB3 peripheral clock enable register (RCC_AHB3ENR) . . . . . 162
5.3.13 RCC APB1 peripheral clock enable register (RCC_APB1ENR) . . . . . 162
5.3.14 RCC APB2 peripheral clock enable register (RCC_APB2ENR) . . . . . 166
5.3.15 RCC AHB1 peripheral clock enable in low-power mode register
(RCC_AHB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 169
5.3.16 RCC AHB2 peripheral clock enable in low-power mode register
(RCC_AHB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 171
5.3.17 RCC AHB3 peripheral clock enable in low-power mode register
(RCC_AHB3LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 172
5.3.18 RCC APB1 peripheral clock enable in low-power mode register
(RCC_APB1LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173
5.3.19 RCC APB2 peripheral clock enabled in low-power mode register
(RCC_APB2LPENR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 177
5.3.20 RCC backup domain control register (RCC_BDCR) . . . . . . . . . . . . . . 179
5.3.21 RCC clock control & status register (RCC_CSR) . . . . . . . . . . . . . . . . 180
5.3.22 RCC spread spectrum clock generation register (RCC_SSCGR) . . . . 182
5.3.23 RCC PLLI2S configuration register (RCC_PLLI2SCFGR) . . . . . . . . . 183
5.3.24 RCC PLLSAI configuration register (RCC_PLLSAICFGR) . . . . . . . . . 186
5.3.25 RCC dedicated clocks configuration register (RCC_DKCFGR1) . . . . 187
5.3.26 RCC dedicated clocks configuration register (DCKCFGR2) . . . . . . . . 189
5.3.27 RCC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192
6 General-purpose I/Os (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
6.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
6.2 GPIO main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
6.3 GPIO functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195
6.3.1 General-purpose I/O (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 198
6.3.2 I/O pin alternate function multiplexer and mapping . . . . . . . . . . . . . . . 198
6.3.3 I/O port control registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199
6.3.4 I/O port data registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199
6.3.5 I/O data bitwise handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199
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