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器件3D模型￥ 25.201
PIC32MX320F032H-40I/MR 用户编程技术手册 - Microchip（微芯）
制造商:
Microchip（微芯）
分类:
微控制器
封装:
QFN-64
描述:
PIC32MX320/340/360/420/440/460 32 位微控制器Microchip PIC32MX320/340/360/420/440/460 系列微控制器是高性能的 32 位设备，基于强大的 MIPS M4K 内核。 丰富的集成板载外围设备和其他功能组合使这些 MCU 通用设备能够适用于各种应用，包括需要 USB 通信的应用。### 微控制器功能MIPS32® M4K® 32 位内核，带 5 级管道 80 MHz 最大频率 - 1.56 DMIPS/MHz (Dhrystone 2.1) 性能，0 等待状态闪存访问 单周期乘法和高性能除法装置 MIPS16e® 模式，可以减少最多 40% 代码长度 两套 32 内核寄存器文件（32 位），可减少中断延迟 预取缓存模块，加速从闪存执行 工作温度范围：-40°C 至 +105°C 引脚与大多数 PIC24/dsPIC® DSC 设备兼容 多电源管理模式 多个中断矢量，可单独编程优先级 故障安全时钟监控模式 可配置监控计时器，带片载低功耗 RC 振荡器，用于 可靠的操作 内部 8 MHz 和 32 KHz 振荡器 3 MHz 至 25 MHz 晶体振荡器 ### 外设10 位模拟到数字转换器 (ADC) - 16 通道 选择外围设备上提供 Atomic SET、CLEAR 和 INVERT 操作 高达 4 通道硬件 DMA，带自动数据尺寸检测 USB 2.0 兼容全速设备和 On-The-Go (OTG) 控制器 - 具有一个专用 DMA 通道 单独的 PLL，用于 CPU 和 USB 时钟 两个 I2C™ 模块 两个 UART 模块 两个 SPI 模块 并行主和从端口 (PMP/PSP)，带 8 位和 16 位数据，多达 16 个地址线路 硬件实时时钟和日历 (RTCC) 五个 16 位计时器/计数器 - 可选择成对组合，形成两个 32 位计时器 五个采集输入 五个比较/PWM 输出 五个外部中断引脚 高速输入/输出引脚可在高达 80 MHz 时切换 所有输入/输出引脚上均为高电流汇电流/源电流 (18 mA/18 mA) 数字输入/输出引脚上可配置漏极开路输出 ### PIC32 微控制器高性能的 32 位微控制器设计用于：高冲击强度图形/用户接口、以太网/USB/CAN 连接、多任务处理嵌入式控制、高性能音频展开
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PIC32MX320F032H-40I/MR数据手册
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PIC32
DS60001145S-page 6 2007-2016 Microchip Technology Inc.
4.2 2-wire Interface
Another possible interface is the 2-wire ICSP port.
Table 4-2 lists the required pin connections. This
interface uses the following two communication lines to
transfer data to and from the PIC32 device being
programmed:
• Serial Program Clock (PGECx)
• Serial Program Data (PGEDx)
These signals are described in the following two
sections. Refer to the specific device data sheet for the
connection of the signals to the chip pins.
4.2.1 SERIAL PROGRAM CLOCK
(PGEC
X
)
PGECx is the clock that controls the updating of the
TAP controller and the shifting of data through the
Instruction or selected Data registers. PGECx is
independent of the processor clock, with respect to
both frequency and phase.
4.2.2 SERIAL PROGRAM DATA (PGED
X
)
PGEDx is the data input/output to the Instruction or
selected Data Registers, it is also the control signal for
the TAP controller. This signal is sampled on the falling
edge of PGECx for some TAP controller states.
TABLE 4-2: 2-WIRE INTERFACE PINS
Device
Pin Name
Programmer
Pin Name
Pin Type Pin Description
MCLR
MCLR P Programming Enable
ENVREG
(2)
N/A I Enable for On-Chip Voltage Regulator
V
DD
, V
BAT
(2)
, and AV
DD
(1)
V
DD
P Power Supply
V
DD
1
V
8
(2)
and V
DDR
1
V
8
(2)
N/A P Power Supply for DDR Interface
V
SS
, V
SS
1
V
8
(2)
, and AV
SS
(1)
V
SS
PGround
V
CAP
(2)
N/A P CPU Logic Filter Capacitor Connection
PGECx PGEC I Primary Programming Pin Pair: Serial Clock
PGEDx PGED I/O Primary Programming Pin Pair: Serial Data
Legend: I = Input O = Output P = Power
Note 1: All power supply and ground pins must be connected, including analog supplies (AV
DD
) and ground (AV
SS
).
2: This pin is not available on all devices. Refer to the “Pin Diagrams” or “Pin Tables” section in the
specific device data sheet to determine availability.
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