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STM32F207VFT6 用户编程技术手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-100
描述:
STM32F207/217，ARM® 32 位 Cortex™-M3 微控制器STMicroelectronics STM32 F2 系列是基于 ARM® Cortex™-M3 的 32 位微控制器，操作频率高达 120 MHz。 STM32F207/217 集成闪存、SRAM，以太网 MAC、高速 USB 2.0 OTG、相机接口，硬件加密支持和外部存储器接口。 STM32 MCU 处理器具有 12 位 ADC、DAC、16位计时器、32 位计时器、RTC 和真随机数生成器 (RNG)。 同时还具有与高级外围设备的标准通信接口，包括 SDIO（一个增强可变静态存储控制器 (FSMC) 接口）和一个用于 CMOS 传感器的相机接口。 闪存：高达 1MB SRAM：高达 128 KB 省电模式套件 两个 PWM 计时器，用于电动机控制 外围设备因 MCU 而不同 SDIO 接口、以太网和相机接口（**仅 STM32F207xx**） I2C、SPI、I2S、USART、USB OTG 高速、USB OTG、CAN 实时存储器加速器 (ART Accelerator™) 与其他 STM32 产品引脚到引脚兼容 温度范围：-40 至 +105°C ### STM32F2 系列 32 位 ARM® Cortex®-M3 微控制器，STMicroelectronics32 位闪存微控制器的 STM32 系列基于 ARM Cortex™ M3 核心的突破 - 为嵌入式应用特别开发的核心。 STM32 系列得益于 Cortex-M3 体系结构增强功能。 120MHz Cortex™-M3 CPU 出色的实时表现 卓越功效 卓越的和新型的外围设备 最大程度的集成 跨族引脚，外围设备和软件兼容性展开
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DocID15491 Rev 5 3/156
PM0056 Contents
2.4 Fault handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
2.4.1 Fault types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
2.4.2 Fault escalation and hard faults . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
2.4.3 Fault status registers and fault address registers . . . . . . . . . . . . . . . . . 42
2.4.4 Lockup . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
2.5 Power management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
2.5.1 Entering sleep mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
2.5.2 Wakeup from sleep mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
2.5.3 The external event input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
2.5.4 Power management programming hints . . . . . . . . . . . . . . . . . . . . . . . . 44
3 The Cortex-M3 instruction set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
3.1 Instruction set summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
3.2 Intrinsic functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50
3.3 About the instruction descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
3.3.1 Operands . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
3.3.2 Restrictions when using PC or SP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52
3.3.3 Flexible second operand . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52
3.3.4 Shift operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53
3.3.5 Address alignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56
3.3.6 PC-relative expressions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56
3.3.7 Conditional execution . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57
3.3.8 Instruction width selection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59
3.4 Memory access instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60
3.4.1 ADR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60
3.4.2 LDR and STR, immediate offset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
3.4.3 LDR and STR, register offset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63
3.4.4 LDR and STR, unprivileged . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64
3.4.5 LDR, PC-relative . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65
3.4.6 LDM and STM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67
3.4.7 PUSH and POP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68
3.4.8 LDREX and STREX . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70
3.4.9 CLREX . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71
3.5 General data processing instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72
3.5.1 ADD, ADC, SUB, SBC, and RSB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
3.5.2 AND, ORR, EOR, BIC, and ORN . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75
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