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器件3D模型￥ 2.351
STM32F030C6T6 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-48
描述:
STM32F03 系列微处理器，STMicroelectronics基于 STMicroelectronics ARM Cortex-M0 的 STM32F0 系列微控制器，包括入门级 ARM Cortex™ M0 32 位 RISC 内核。 STM32F030 超值型提供高速嵌入式存储器，具有各种增强型外设和 I/O。 有如 I2C、SPI 和 USART 等通信接口，以及 12 位 ADC、16 位计时器和一个高级控制 PWM 计时器。 ST 的 STM32F0 MCU 高级体系结构与 STM32 平台相结合，允许低功率应用设计，提供不同的封装类型。 具有嵌入式闪存和 SRAM 的 ARM Cortex™-M0 内核处理器与所有 ARM 工具和软件兼容。 STM32F030 ARM 处理器微控制器 (MCU) 适用于广泛的应用，包括应用控制和用户界面、手持设备、A/V 接收器、PC 外设、游戏平台、消费者电器用具、打印机、报警系统和 HVAC。 频率：48 MHz CPU 闪存：高达 64 K 字节 SRAM：高达 8 K 字节 电源：2.4 至 3.6 V 温度范围：- 40 至 +85 °C ### STM32F0 系列 32 位 ARM® Cortex®-M0 微控制器，STMicroelectronicsSTM32 F0 系列 32 位闪存微控制器 (MCU) 基于 ARM Cortex™-M0 核心；为嵌入式应用特别开发的核心。 STMicroelectronics 的 STM32 ARM Cortex™ M 处理器得益于 Cortex-M0 体系结构增强功能，包括数字信号处理、实时性能、低电压和低功率。 ST ARM® STM32 F0 主流系列提供 32 位性能，且特别适用于小项目或平台决策，具有易于使用功能。展开
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STM32F030C6T6数据手册
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DocID025023 Rev 3 5/771
RM0360 Contents
23
8 General-purpose I/Os (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
8.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
8.2 GPIO main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
8.3 GPIO functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
8.3.1 General-purpose I/O (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130
8.3.2 I/O pin alternate function multiplexer and mapping . . . . . . . . . . . . . . . 130
8.3.3 I/O port control registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131
8.3.4 I/O port data registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131
8.3.5 I/O data bitwise handling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
8.3.6 GPIO locking mechanism . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
8.3.7 I/O alternate function input/output . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
8.3.8 External interrupt/wakeup lines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133
8.3.9 Input configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133
8.3.10 Output configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134
8.3.11 Alternate function configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134
8.3.12 Analog configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 135
8.3.13 Using the HSE or LSE oscillator pins as GPIOs . . . . . . . . . . . . . . . . . 136
8.3.14 Using the GPIO pins in the RTC supply domain . . . . . . . . . . . . . . . . . 136
8.4 GPIO registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 137
8.4.1 GPIO port mode register (GPIOx_MODER) (x =A..D, F) . . . . . . . . . . . 137
8.4.2 GPIO port output type register (GPIOx_OTYPER) (x = A..D, F) . . . . . 137
8.4.3 GPIO port output speed register (GPIOx_OSPEEDR)
(x = A..D, F) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138
8.4.4 GPIO port pull-up/pull-down register (GPIOx_PUPDR)
(x = A..,D, F) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138
8.4.5 GPIO port input data register (GPIOx_IDR) (x = A..D, F) . . . . . . . . . . 139
8.4.6 GPIO port output data register (GPIOx_ODR) (x = A..D, F) . . . . . . . . 139
8.4.7 GPIO port bit set/reset register (GPIOx_BSRR) (x = A..D, F) . . . . . . . 139
8.4.8 GPIO port configuration lock register (GPIOx_LCKR)
(x = A..B) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140
8.4.9 GPIO alternate function low register (GPIOx_AFRL)
(x = A..D, ) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141
8.4.10 GPIO alternate function high register (GPIOx_AFRH)
(x = A..D, F) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142
8.4.11 GPIO port bit reset register (GPIOx_BRR) (x =A..D, F) . . . . . . . . . . . . 142
8.4.12 GPIO register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143
9 System configuration controller (SYSCFG) . . . . . . . . . . . . . . . . . . . . 145
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