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器件3D模型￥ 19.084
STM8S207K6T3C 产品设计参考手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-32
描述:
STM8S 8 位微控制器，STMicroelectronicsSTM8S 系列通用 8 位闪存微控制器是具有一个 3 级管线的 STM8 的高级芯型号。 STM8S 受益于在 24MHz 在操作高达 20MIPS 的高级芯体系架构。 嵌入式 EEPROM、RC 振荡器和完整的外围设备为设计人员提供坚固且可靠的解决方案。 ### STM8 8 位微控制器，STMicroelectronicsSTM8 平台已应用于高性能 8 位核心且是最先进的外围设备。 8 位微控制器以 16/24MHz 操作，具有高达 128kB 闪存、内部 RAM 和 EEPROM、8/16 位计时器、A/D 转换器、D/A 转换器、比较器、串行接口和可选显示控制器。
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STM8S207K6T3C数据手册
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Contents RM0016
4/467 DocID14587 Rev 14
6.8 Interrupt mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67
6.9 ITC and EXTI registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68
6.9.1 CPU condition code register interrupt bits (CCR) . . . . . . . . . . . . . . . . . 68
6.9.2 Software priority register x (ITC_SPRx) . . . . . . . . . . . . . . . . . . . . . . . . . 69
6.9.3 External interrupt control register 1 (EXTI_CR1) . . . . . . . . . . . . . . . . . . 70
6.9.4 External interrupt control register 1 (EXTI_CR2) . . . . . . . . . . . . . . . . . . 71
6.9.5 ITC and EXTI register map and reset values . . . . . . . . . . . . . . . . . . . . . 72
7 Power supply . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
8 Reset (RST) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74
8.1 “Reset state” and “under reset” definitions . . . . . . . . . . . . . . . . . . . . . . . . 74
8.2 Reset circuit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74
8.3 Internal reset sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75
8.3.1 Power-on reset (POR) and brown-out reset (BOR) . . . . . . . . . . . . . . . . 75
8.3.2 Watchdog reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75
8.3.3 Software reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
8.3.4 SWIM reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
8.3.5 Illegal opcode reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
8.3.6 EMC reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76
8.4 RST register description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77
8.4.1 Reset status register (RST_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77
8.5 RST register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77
9 Clock control (CLK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78
9.1 Master clock sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80
9.1.1 HSE (high-speed external) clock signal . . . . . . . . . . . . . . . . . . . . . . . . . 80
9.1.2 HSI (high-speed internal) clock signal . . . . . . . . . . . . . . . . . . . . . . . . . . 81
9.1.3 LSI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82
9.2 Master clock switching . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
9.2.1 System startup . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
9.2.2 Master clock switching procedures . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
9.3 Low-speed clock selection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86
9.4 CPU clock-divider . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86
9.5 Peripheral clock-gating (PCG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87
9.6 Clock security system (CSS) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88
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