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STM32F107RBT6 用户编程技术手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-64
描述:
STM32F105/107 系列微处理器，STMicroelectronicsSTMicroelectronics **STM32F105/107** 处理器，带 Cortex M3 芯，速度高达 72 MHz。 STM32 系列包括基于 ARM 的 32 位 MCU，带 16 位计时器、CAN、ADC、USB 2.0 全速接口/OTG、以太网 MAC 和通信接口（I2C、SPI、UART）。 STM32 ARM Cortex-M3 32 位闪存微控制器工作时具有低电压、低功率，带有实时功能。 MCU 体系结构具有一个易于使用的 STM32 平台，提供三种不同的封装。 这些嵌入式设备可在如电动机驱动；打印机和扫描仪；警报；和工业应用的应用中使用。 ARM 的 Cortex 智能模块处理器 温度范围：-40 至 +85 °C 电源：2 V 至 3.6 V 闪存：高达 256 Kb SRAM：高达 64 Kb 省电模式套件 ### STM32F1 系列 32 位 ARM® Cortex®-M3 微控制器，STMicroelectronics32 位闪存微控制器的 STM32 系列基于 ARM Cortex™ M3 核心的突破 - 为嵌入式应用特别开发的核心。 STM32 系列得益于 Cortex-M3 体系结构增强功能，包括为传达改进性能而设置的 Thumb-2 指令，带更好的编码密度，对中断更快的反应，所有的均和领先的工业功耗相接合。出色的实时表现 卓越功效 卓越的和新型的外围设备 最大程度的集成 跨族引脚，外围设备和软件兼容性展开
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STM32F107RBT6数据手册
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Contents PM0056
2/156 DocID15491 Rev 5
Contents
1 About this document . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.1 Typographical conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.2 List of abbreviations for registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.3 About the STM32 Cortex-M3 processor and core peripherals . . . . . . . . . . 9
1.3.1 System level interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
1.3.2 Integrated configurable debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
1.3.3 Cortex-M3 processor features and benefits summary . . . . . . . . . . . . . . 11
1.3.4 Cortex-M3 core peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
2 The Cortex-M3 processor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1 Programmers model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1.1 Processor mode and privilege levels for software execution . . . . . . . . . 13
2.1.2 Stacks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1.3 Core registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
2.1.4 Exceptions and interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
2.1.5 Data types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
2.1.6 The Cortex microcontroller software interface standard (CMSIS) . . . . . 23
2.2 Memory model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
2.2.1 Memory regions, types and attributes . . . . . . . . . . . . . . . . . . . . . . . . . . 25
2.2.2 Memory system ordering of memory accesses . . . . . . . . . . . . . . . . . . . 26
2.2.3 Behavior of memory accesses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
2.2.4 Software ordering of memory accesses . . . . . . . . . . . . . . . . . . . . . . . . 27
2.2.5 Bit-banding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
2.2.6 Memory endianness . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
2.2.7 Synchronization primitives . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
2.2.8 Programming hints for the synchronization primitives . . . . . . . . . . . . . . 32
2.3 Exception model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.1 Exception states . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.2 Exception types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.3 Exception handlers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
2.3.4 Vector table . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
2.3.5 Exception priorities . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
2.3.6 Interrupt priority grouping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
2.3.7 Exception entry and return . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
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