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器件3D模型￥ 30.275
STM32L152VBT6A 用户编程技术手册 - ST Microelectronics（意法半导体）
制造商:
ST Microelectronics（意法半导体）
分类:
微控制器
封装:
LQFP-100
描述:
STM32L152 系列微处理器，STMicroelectronics超低功率 **STM32 L152** ARM ®Cortex®-M3 微控制器具有 ADC、DAC、比较器和计时器。 ARM Cortex-M3 32 位 RISC 内核处理器具有高性能 **STM32** 平台，工作频率为 32MHz，带集成 MPU、高速嵌入式闪存、RAM 和一系列外围设备。 此外，**STM32 L152** 包含 SPI、I²C、USART 和 USB 通信接口，它们还可提供电容性感应通道。 适用于多种应用，包括应用控制和用户界面、PC 外围设备、游戏、报警系统、实用计量、医疗设备、GPS 和手持设备。实时时钟 (RTC) 12 位 ADC 1MSPS 12 位 DAC 16 位和 32 位计时器 电源：1.8 V 至 3.6 V 温度范围：-40 °C 至 +85 °C LCD 控制器 ### STM32L1 系列 32 位 ARM® Cortex®-M3 微控制器，STMicroelectronics基于 ARM® Cortex™-M3 的 STM32 L1 系列采用 ST 专有超低泄漏工艺技术，具有创新自主的动态电压调节和五个 (5) 低功耗模式，提供了前所未有的平台灵活性以适用任何应用场合。 STM32 L1 系列延伸了超低功耗概念，同时不影响性能。超低功耗模式：300nA，带备份寄存器（3 个唤醒引脚） 超低功耗模式 + 实时时钟 (RTC)：900nA，带备份寄存器（3 个唤醒引脚） 低功耗运行模式：低至 9μA 动态运行模式：低至 230μA/MHz展开
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Contents PM0056
2/156 DocID15491 Rev 5
Contents
1 About this document . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.1 Typographical conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.2 List of abbreviations for registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
1.3 About the STM32 Cortex-M3 processor and core peripherals . . . . . . . . . . 9
1.3.1 System level interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
1.3.2 Integrated configurable debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
1.3.3 Cortex-M3 processor features and benefits summary . . . . . . . . . . . . . . 11
1.3.4 Cortex-M3 core peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
2 The Cortex-M3 processor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1 Programmers model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1.1 Processor mode and privilege levels for software execution . . . . . . . . . 13
2.1.2 Stacks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
2.1.3 Core registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
2.1.4 Exceptions and interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
2.1.5 Data types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
2.1.6 The Cortex microcontroller software interface standard (CMSIS) . . . . . 23
2.2 Memory model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
2.2.1 Memory regions, types and attributes . . . . . . . . . . . . . . . . . . . . . . . . . . 25
2.2.2 Memory system ordering of memory accesses . . . . . . . . . . . . . . . . . . . 26
2.2.3 Behavior of memory accesses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
2.2.4 Software ordering of memory accesses . . . . . . . . . . . . . . . . . . . . . . . . 27
2.2.5 Bit-banding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
2.2.6 Memory endianness . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
2.2.7 Synchronization primitives . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
2.2.8 Programming hints for the synchronization primitives . . . . . . . . . . . . . . 32
2.3 Exception model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.1 Exception states . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.2 Exception types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
2.3.3 Exception handlers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
2.3.4 Vector table . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
2.3.5 Exception priorities . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
2.3.6 Interrupt priority grouping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
2.3.7 Exception entry and return . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
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