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JS28F320J3F75E
器件3D模型
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JS28F320J3F75E数据手册
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An IMPORTANT NOTICE at the end of this data sheet addresses availability, warranty, changes, use in safety-critical applications,
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English Data Sheet: SPRS880
TMS320F28379D
,
TMS320F28377D
TMS320F28376D, TMS320F28375D, TMS320F28374D
ZHCSC63F DECEMBER 2013REVISED NOVEMBER 2015
TMS320F2837xD 双核 Delfino™ 微控制器
1 器件件概
1
1.1 特性
1
双核架构
两个 TMS320C28x 32 CPU
200MHz
IEEE-754 单精度浮点单元 (FPU)
三角法数学单元 (TMU)
Viterbi / 复杂数学单元 (VCU-II)
两个可编程控制律加速器 (CLA)
200MHz
IEEE 754 单精度浮点指令
独立于主 CPU 之外执行代码
片上存储器
512KB (256KW) 1MB (512KW) 闪存(ECC
保护)
172KB (86KW) 204KB (102KW) RAMECC
保护或奇偶校验保护)
支持第三方开发的双区安全
时钟和系统控制
两个内部零引脚 10MHz 振荡器
片上晶体振荡器
窗口化看门狗定时器模块
丢失时钟检测电路
1.2V 内核,3.3V I/O 设计
系统外设
两个支持 ASRAM SDRAM 的外部存储器接口
(EMIF)
6 通道直接存储器存取 (DMA) 控制器
多达 169 个支持输入滤波的独立可编程、复用通
用输入/输出 (GPIO) 引脚
扩展外设中断控制器 (ePIE)
多个支持外部唤醒的低功耗模式 (LPM)
通信外设
USB 2.0 (MAC + PHY)
支持 12 引脚 3.3V 兼容通用并行端口 (uPP) 接口
两个控制器局域网 (CAN) 模块(引脚可引导)
三个高速(最高 50MHzSPI 端口(引脚可引
导)
两个多通道缓冲串行端口 (McBSP)
四个串行通信接口 (SCI/UART)(引脚可引导)
两个 I
2
C 接口(引脚可引导)
模拟子系统
多达四个模数转换器 (ADC)
16 位模式
每个转换器的吞吐量为 1.1MSPS(系统吞
吐量高达 4.4MSPS
差分输入
多达 12 个外部通道
12 位模式
每个转换器的吞吐量为 3.5MSPS(系统吞
吐量高达 14MSPS
单端输入
多达 24 个外部通道
每个 ADC 上有单个采样与保持 (S/H) 电路
ADC 转换的硬件集成后置处理
饱和偏移校准
定点计算误差
具有中断功能的高、低和过零比较
触发至采样延迟捕捉
八个具有 12 位数模转换器 (DAC) 参考的窗口化
比较器
3 12 位缓冲 DAC 输出
增强型控制外设
24 条具有增强功能的脉宽调制器 (PWM) 通道
16 条高分辨率脉宽调制器 (HRPWM) 通道
8 PWM 模块的 A B 通道均可实现高分
辨率
死区支持(对于标准和高分辨率均支持)
6 个增强型捕捉 (eCAP) 模块
3 个增强型正交编码器脉冲 (eQEP)模块
八条 Δ-Σ 滤波器模块 (SDFM) 输入通道,每条通
2 个并联滤波器
标准 SDFM 数据滤波
用于快速响应超范围情况的比较器滤波器

JS28F320J3F75E 数据手册

Micron(镁光)
66 页 / 2.14 MByte
Micron(镁光)
208 页 / 2.54 MByte

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